FPGA AD9653调试记录

很久没有用过这种低俗的AD了，该AD为采样率最大支持125M，4通道，配置相对比较简单，只要就是如果需要改采样率时需要注意一下，每次配置完采样寄存器需要通过0XFF寄存器更新一下AD9653的数据时序关系如下图我这里选择的模式为. 16-Bit DDR/SDR, Two-Lane, 2× Frame Mode模式，对数据解析就是通过select io进行解析，比例关系为1:8，意味着时钟需要分频为

知芯电子科技

10196人浏览 · 2021-07-31 13:31:27

知芯电子科技 · 2021-07-31 13:31:27 发布

很久没有用过这种低速的AD了，该AD为采样率最大支持125M，4通道，配置相对比较简单，只要就是如果需要改采样率时需要注意一下，每次配置完采样寄存器
在这里插入图片描述
需要通过0XFF寄存器更新一下

AD9653的数据时序关系如下图

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我这里选择的模式为. 16-Bit DDR/SDR, Two-Lane, 2× Frame Mode模式，对数据解析就是通过select io进行解析，比例关系为1:8，意味着时钟需要分频为1/4最终的数据。对于找窗口，个人还是习惯使用DCM动态调相的方式。值得注意的是，这个AD数据中还有一个FCO信号，这个信号用来对其内部数据。可以通过SELECT IO的bitslip信号进行调整

最后调试这种AD器件有一个小技巧，就是前期先把测试模式用VIO拉出来，这样对于分析数据有帮助

最后程序框架

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由于我这个板子的直流偏执比较大，通过芯片自带的调谐偏执的寄存器也没有办法回到0，所以增加一个去直流模块

效果图：

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